職責(zé)描述：
?1、?Module?level?design?and?implementation；
?模塊級設(shè)計和實現(xiàn)；
?2、?Module?level?documentation?and?integration；
?模塊級文檔和集成；
?3、?Design?constrain?define；
?定義設(shè)計規(guī)范；
?4、Design?quality?improvement。
?改進提高設(shè)計質(zhì)量。
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任職要求：
?1、Master?degree?or?above?in?related?fields?such?electrical?engineering,?micro-electronics?and?etc，3+?years?IC?design?experience；
?電子工程、微電子等相關(guān)專業(yè)碩士及以上學(xué)歷，3年及以上IC設(shè)計經(jīng)驗；
?2、Rich?experience?in?verilog?coding?and?good?coding?style；
?有豐富的verilog代碼編寫經(jīng)驗及良好的代碼風(fēng)格習(xí)慣；
?3、Be?familiar?with?synthesis?and?timing?analysis,?be?capable?of?writing?design?constrains
?熟悉綜合分析和時序分析，可編寫設(shè)計規(guī)范；
?4、Good?English?writing?and?speaking?skills；
?良好的英語讀寫能力；
?5、Be?proactive?and?with?strong?sense?of?teamwork。
?工作積極主動團隊合作意識強。
